news 2026/5/7 3:13:47

智能音箱开发实战(二):EVT 阶段——从“点亮”到“调通”的信号排雷

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张小明

前端开发工程师

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智能音箱开发实战(二):EVT 阶段——从“点亮”到“调通”的信号排雷

第二篇我们将进入硬件开发的“深水区”——EVT(Engineering Validation Test,工程验证)

EVT 是将纸面上的选型转化为真实物理实体的过程。这也是 FAE 和硬件工程师最辛苦的一段日子:你需要面对第一版 PCB 上的各种底噪、热量以及结构干涉问题。


周期:第 3 - 5 个月核心任务:验证电路逻辑、调通音频链路、解决电磁兼容(EMC)与物理结构冲突。

一、 首板点亮:不仅仅是“亮起来”

拿到第一批 EVT PCB 样板后,重点在于电源和高速信号的稳定性。

  • PDN(电源分配网络)测试:2.0 架构的功放(PA)在播放大动态音乐时,瞬时电流非常大。务必观察联发科 SoC 的核心电压在峰值功率下是否会出现抖动或跌落,防止系统异常重启。
  • 时序与链路验证:检查 I2S/TDM 链路的时钟信号。如果 MCLK、BCLK 存在过大的过冲或振铃,会直接导致音频采样丢包,产生“咔哒”杂音。

二、 声学避坑:解决物理结构的“先天不足”

EVT 阶段的样机通常采用 3D 打印或 CNC 手板。这是验证 2.0 物理隔离效果的唯一机会。现在3D打印其实便宜了,不会像以前开模那么高的费用了。

  1. 气密性“一票否决制”:
    • 现象:麦克风拾取的信号中带有刺耳的风噪。
    • 排查:录音播放特征音频,检查麦克风胶套是否压紧,喇叭出音孔与外壳之间是否有漏气。在 2.0 音箱中,哪怕 0.1mm 的缝隙也会导致 AEC(回声消除)算法失效。
  2. 结构传导震动 (Vibration):
    • 验证:在不播放声音的情况下,用手指敲击机壳,观察麦克风波形。
    • 处理:如果喇叭震动直接传导给双麦阵列,需在 EVT 阶段优化支架设计,加入软胶悬浮结构。

三、 音频链路调通:KWS 与 Loopback 闭环

在这个阶段,软件算法团队开始深度介入。

  • 回采信号 (Loopback) 校准:验证 PA 传回 SoC 的信号是否与麦克风录到的音乐信号在时间戳上对齐。如果同步偏移过大,打断(Barge-in)功能将无法实现。
  • KWS(本地唤醒)初调:
    • 底噪检查:检查麦克风在安静环境下的静态底噪。如果底噪过高(通常是电源干扰),会严重压缩唤醒距离。
    • 增益策略:确定麦克风的模拟增益(Analog Gain)和数字增益。

四、 射频与干扰 (RF/EMC) 的“贴身肉搏”

智能音箱是一个紧凑的辐射源。

  • TDD Noise(Wi-Fi 干扰音):这是 MTK 平台常见的挑战。当 Wi-Fi 进行大流量传输时,射频能量可能耦合到音频链路中。在 EVT 阶段需要通过增加滤波电容、调整走线来消除“滋滋”声。
  • 天线性能初测:2.0 架构的大体积喇叭磁钢会吸收 Wi-Fi 信号。需测试天线在装壳状态下的效率,确保在线流媒体播放不卡顿。

五、 EVT 阶段交付 Checklist

  • 硬件:所有外设(Wi-Fi/BT/LED/按键/PA)驱动加载正常,功耗符合预期。
  • 声学:左右声道平衡度达标,初步气密性测试通过。
  • 算法:本地唤醒词在 3 米内(0 噪声)识别率 > 90%,打断功能初步可用。
  • 结构:完成堆叠校验,确认没有导致电路短路或散热死角的物理干涉。

FAE 经验谈:EVT 阶段最忌讳“差不多就行”。如果在 EVT 阶段为了赶进度而忽视了细微的漏音或电源纹波,这些问题会在正式开模后的 DVT 阶段被无限放大,届时修改模具和 PCB 的代价将是毁灭性的。


下一篇预告:我们将进入DVT(设计验证)阶段。正式钢模到位,产品迎来“金身”。我们将面对残酷的可靠性测试(跌落、盐雾、高低温)以及决定音质灵魂的声学精调(Tuning)

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